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浙江大学学报(工学版)
J4  2006, Vol. 40 Issue (12): 2139-2143    
论文     
AVS视频解码器的一种结构设计与硬件实现
胡倩，张珂，虞露（浙江大学 信息与电子工程学系，浙江 杭州 310027）
 全文: PDF 
摘要：

为了推动音视频编码标准（AVS）解码芯片产业的发展，提出了一种针对AVS视频标准基准档次4.0级别解码器的超大规模集成电路（VLSI）实现结构.通过分析实现复杂度，阐述了AVS视频解码器的总体框架、主要模块的功能及结构.解码器采用块级流水结构， 主要模块之间实现并行处理.同时根据AVS算法特点，给出了变长解码模块、反整数余弦变换模块和环路滤波模块的硬件实现结构.解码器在现场可编程门阵列（FPGA）上实现，并给出了各模块的FPGA资源占用情况.实现结果表明，该 AVS视频解码器实现结构能在54 MHz时钟频率下完成对25帧/s、720×576、4∶2∶0格式AVS码流的实时解码.
关键词： AVS;  视频解码器;  硬件结构设计;  FPGA    
出版日期: 2006-12-20
基金资助:

国家自然科学基金资助项目(60333020;90207005).
作者简介: 胡倩（1981-），女，湖南株洲人，硕士，从事视频编解码及其ASIC设计研究. E－mail:huqian0610@yahoo.com.cn
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胡倩
张珂
虞露

引用本文:

胡倩 张珂 虞露. AVS视频解码器的一种结构设计与硬件实现[J]. J4, 2006, 40(12): 2139-2143.

HU Qian, ZHANG Ke, YU Lou. . J4, 2006, 40(12): 2139-2143.

链接本文:

http://www.zjujournals.com/xueshu/eng/CN/    或    http://www.zjujournals.com/xueshu/eng/CN/Y2006/V40/I12/2139

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